PXN20RM Datasheet, PDF (245/1376 Pages) Freescale Semiconductor, Inc – PXN20 Microcontroller

System Integration Unit (SIU)
Offset: SIU_BASE + 0x0D44
Access: User read/write
0
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
R _{EMIOS EMIOS EMIOS EMIOS EMIOS EMIOS EMIOS EMIOS EMIOS EMIOS EMIOS EMIOS EMIOS EMIOS EMIOS EMIOS}
W ³¹
30
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28
27
26
25
24
23 22 21 20 19 18 17
16
Reset 0
0
0
0
0
0
0
0
0000000
0
16
17
18
19
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28
29
30
31
R _{EMIOS EMIOS EMIOS EMIOS EMIOS EMIOS EMIOS EMIOS EMIOS EMIOS EMIOS EMIOS EMIOS EMIOS EMIOS EMIOS}
W ¹⁵
14
13
12
11
10
9
8
7
6
5
4
3
2
1
0
Reset 0
0
0
0
0
0
0
0
0000000
0
Figure 8-62. SIU_EMIOSA Select Register for DSPI_A (SIU_EMIOSA)
Table 8-41. SIU_EMIOSA Field Descriptions
Field
Description
EMIOSn
eMIOS Channel Enable.
0 This eMIOS channel is not enabled.
1 This eMIOS channel is enabled.
8.3.2.55 SIU_DSPIAH/L Select Register for DSPI_A (SIU_DSPIAHLA)
The SIU_DSPIAHLA register enables the data path from the Masked Serial GPO register for DSPI_A to
the equivalent bit position in the DSPI_A channel frame.
Offset: SIU_BASE + 0x0D48
R
W
Reset
0
DSPI
AH
31
0
1
DSPI
AH
30
0
2
DSPI
AH
29
0
3
DSPI
AH
28
0
4
DSPI
AH
27
0
5
DSPI
AH
26
0
6
DSPI
AH
25
0
7
DSPI
AH
24
0
Access: User read/write
8
DSPI
AH
23
0
9
DSPI
AH
22
0
10
DSPI
AH
21
0
11
DSPI
AH
20
0
12
DSPI
AH
19
0
13
DSPI
AH
18
0
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DSPI
AH
17
0
15
DSPI
AH
16
0
R
W
Reset
16
DSPI
AL
15
0
17
DSPI
AL
14
0
18
DSPI
AL
13
0
19
DSPI
AL
12
0
20
DSPI
AL
11
0
21
DSPI
AL
10
0
22
DSPI
AL
9
0
23
DSPI
AL
8
0
24
DSPI
AL
7
0
25
DSPI
AL
6
0
26
DSPI
AL
5
0
27
DSPI
AL
4
0
28
DSPI
AL
3
0
29
DSPI
AL
2
0
30
DSPI
AL
1
0
Figure 8-63. SIU_DSPIAH/L Select Register for DSPI_A (SIU_DSPIAHLA)
31
DSPI
AL
0
0
Table 8-42. SIU_DSPIAHLA Field Descriptions
Field
Description
DSPIAHn Data Path Enable for DSPI_A High.
0 Data path disabled to DSPI_A High.
1 Data path enabled to DSPI_A High.
DSPIALn Data Path Enable for DSPI_A Low.
0 Data path disabled to DSPI_A Low.
1 Data path enabled to DSPI_A Low.
Freescale Semiconductor
PXN20 Microcontroller Reference Manual, Rev. 1
8-63