MC68HC08AZ0 Datasheet, PDF (429/444 Pages) Motorola, Inc – Advance Information

Freescale Semiconductor, Inc.
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A
accumulator (A) . . . . . . . . . . . . . . . . . . . . . .69
ACK1 bit (IRQ interrupt request acknowledge
bit). . . . . . . . . . . . . . . . . .172, 175–177
ACKK
Keyboard acknowledge bit. . . . . . . . . .324
ACQ
PBWC . . . . . . . . . . . . . . . . . . . . . . . . .124
ADC
analog ground pin (AVSS/VREFL). . . .312
analog power pin (VDDAREF) . . . . . . .312
continuous conversion . . . . . . . . . . . . .311
conversion time . . . . . . . . . . . . . . . . . .310
interrupts . . . . . . . . . . . . . . . . . . . . . . .311
port I/O pins . . . . . . . . . . . . . . . . . . . . .310
voltage conversion . . . . . . . . . . . . . . . .310
voltage in (ADVIN) . . . . . . . . . . . . . . . .312
voltage reference pin (VREFH) . . . . . .312
ADC characteristics. . . . . . . . . . . . . . . . . .402
ADC clock register (ADCLKR). . . . . . . . . .316
ADC data register (ADR). . . . . . . . . . . . . .316
ADC status and control register (ADSCR) 313
ADCO - ADC
continuous conversion . . . . . . . . . . . . .314
ADICLK
ADC input clock select . . . . . . . . . . . . .317
AIEN - ADC
interrupt enable . . . . . . . . . . . . . . . . . .314
arithmetic/logic unit (ALU) . . . . . . . . . . . . . .73
AUTO
PBWC . . . . . . . . . . . . . . . . . . . . . . . . .123
B
baud rate
SCI module . . . . . . . . . . . . . . . . . . . . .214
BCFE
SBFCR . . . . . . . . . . . . . . . . . . . . . . . . 106
BCFE bit (break clear flag enable bit) . . . 106,
176, 198
BCS
PCTL . . . . . . . . . . . . . . . . . . . . . . . . . . 122
BIH instruction. . . . . . . . . . . . . . . . . . . . . . 175
BIL instruction . . . . . . . . . . . . . . . . . . . . . . 175
BKF bit (SCI break flag bit) . . . . . . . . . . . . 212
BKPT signal . . . . . . . . . . . . . . . . . . . . . . . 140
block diagram
CGM . . . . . . . . . . . . . . . . . . . . . . . . . . 110
break character . . . . . . . . . . . . . . . . . 186, 209
break interrupt. . . . . . . . . . . . . . . . . . . . 96, 99
causes . . . . . . . . . . . . . . . . . . . . . . . . . 140
during wait mode . . . . . . . . . . . . . . . . . 101
effects on COP . . . . . . . . . . . . . . 142, 164
effects on CPU . . . . . . . . . . . . . . . 74, 142
effects on DMA . . . . . . . . . . . . . . . . . . 142
effects on PIT . . . . . . . . . . . . . . . . . . . 302
effects on SPI . . . . . . . . . . . . . . . . . . . 239
effects on TIM . . . . . . . . . . . . . . . 142, 288
effects on TIMA . . . . . . . . . . . . . . . . . . 264
flag protection during . . . . . . . . . . . . . . 100
break module
break address registers (BRKH/L). . . 140,
142–143
break status and control register (BRK-
SCR) . . . . . . . . . . . . . . . . . 140, 143
break signal. . . . . . . . . . . . . . . . . . . . . . . . 152
BRKA bit (break active bit) . . . . . . . . 140, 143
BRKE bit (break enable bit) . . . . . . . . . . . 143
bus frequency . . . . . . . . . . . . . . . . . . . . . . . 68
bus timing . . . . . . . . . . . . . . . . . . . . . . . . . . 89
C
C bit
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