MC68HC908GT16 Datasheet, PDF (26/412 Pages) Motorola, Inc – Microcontrollers

List of Figures
Technical Data
26
Figure
Title
Page
16-18 Data Direction Register E (DDRE) . . . . . . . . . . . . . . . . . . . . . 246
16-19 Port E I/O Circuit. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 247
18-1 ESCI Module Block Diagram . . . . . . . . . . . . . . . . . . . . . . . . . 255
18-2 ESCI I/O Register Summary. . . . . . . . . . . . . . . . . . . . . . . . . . 256
18-3 SCI Data Formats . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 257
18-4 ESCI Transmitter . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 258
18-5 ESCI Receiver Block Diagram . . . . . . . . . . . . . . . . . . . . . . . . 262
18-6 Receiver Data Sampling . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 263
18-7 Slow Data . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 266
18-8 Fast Data . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 267
18-9 ESCI Control Register 1 (SCC1) . . . . . . . . . . . . . . . . . . . . . . 272
18-10 ESCI Control Register 2 (SCC2) . . . . . . . . . . . . . . . . . . . . . . 275
18-11 ESCI Control Register 3 (SCC3) . . . . . . . . . . . . . . . . . . . . . . 278
18-12 ESCI Status Register 1 (SCS1) . . . . . . . . . . . . . . . . . . . . . . .279
18-13 Flag Clearing Sequence . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 282
18-14 ESCI Status Register 2 (SCS2) . . . . . . . . . . . . . . . . . . . . . . .283
18-15 ESCI Data Register (SCDR). . . . . . . . . . . . . . . . . . . . . . . . . . 284
18-16 ESCI Baud Rate Register (SCBR) . . . . . . . . . . . . . . . . . . . . . 284
18-17 ESCI Prescaler Register (SCPSC) . . . . . . . . . . . . . . . . . . . . . 286
18-18 ESCI Arbiter Control Register (SCIACTL) . . . . . . . . . . . . . . . 290
18-19 ESCI Arbiter Data Register (SCIADAT) . . . . . . . . . . . . . . . . . 292
18-20 Bit Time Measurement with ACLK = 0 . . . . . . . . . . . . . . . . . .293
18-21 Bit Time Measurement with ACLK = 1, Scenario A . . . . . . . . 293
18-22 Bit Time Measurement with ACLK = 1, Scenario B . . . . . . . . 293
19-1 SIM Block Diagram . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .297
19-2 SIM I/O Register Summary. . . . . . . . . . . . . . . . . . . . . . . . . . . 298
19-3 System Clock Signals . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 299
19-4 External Reset Timing . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 301
19-5 Internal Reset Timing . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 302
19-6 Sources of Internal Reset . . . . . . . . . . . . . . . . . . . . . . . . . . . .302
19-7 POR Recovery . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 303
19-8 Interrupt Entry Timing . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 307
19-9 Interrupt Recovery Timing . . . . . . . . . . . . . . . . . . . . . . . . . . . 307
19-10 Interrupt Processing . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .308
19-11 Interrupt Recognition Example . . . . . . . . . . . . . . . . . . . . . . . . 309
MC68HC908GT16 • MC68HC908GT8 — Rev. 2
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