S9S12G128F0CLF Datasheet, PDF (122/1158 Pages) Freescale Semiconductor, Inc – MC9S12G Family Reference Manual

Port Integration Module (S12GPIMV1)
Table 2-4. Signals and Priorities
Port Pin
Signal
Signals per Device and Package
(signal priority on pin from top to bottom)
Legend
■ Signal available on pin
❍ Routing option on pin
❏ Routing reset location
Not available on pin
I/O
Description
100
64
48
32
20
C
PC7
DACU1 ■
O DAC1 output unbuffered
[PC7]
■■■
I/O GPIO
PC6
AMPP1 ■
I DAC1 non-inv. input (+)
[PC6]
■■■
I/O GPIO
PC5
AMPM1 ■
I DAC1 inverting input (-)
[PC5]
■■■
I/O GPIO
PC4-PC2 AN15-AN13 ❍ ❍
I ADC analog
[PC4:PC2] ■ ■ ■
I/O GPIO
PC1-PC0 AN11-AN10 ❍ ❍
I ADC analog
[PC1:PC0] ■ ■ ■
I/O GPIO
D PD7-PD0 [PD7:PD0] ■ ■ ■
I/O GPIO
E
PE1
XTAL
■ ■ ■ ■ ■ ■ ■ ■ ■ ■ ■ ■ ■ ■ ■ ■ ■ ■ ■ ■ ■ - CPMU OSC signal
TXD0
❏ ❏ I/O SCI transmit
IOC3
❍ ❍ I/O Timer channel
PWM1
■ ■ O PWM channel
ETRIG1
■ ■ I ADC external trigger
[PE1]
■ ■ ■ ■ ■ ■ ■ ■ ■ ■ ■ ■ ■ ■ ■ ■ ■ ■ ■ ■ ■ I/O GPIO
PE0
EXTAL ■ ■ ■ ■ ■ ■ ■ ■ ■ ■ ■ ■ ■ ■ ■ ■ ■ ■ ■ ■ ■ - CPMU OSC signal
RXD0
❏ ❏ I SCI receive
IOC2
❍ ❍ I/O Timer channel
PWM0
■ ■ O PWM channel
ETRIG0
■ ■ I ADC external trigger
[PE0]
■ ■ ■ ■ ■ ■ ■ ■ ■ ■ ■ ■ ■ ■ ■ ■ ■ ■ ■ ■ ■ I/O GPIO
MC9S12G Family Reference Manual, Rev.1.10
122
Freescale Semiconductor