PT7A6632 Datasheet, PDF (53/61 Pages) Pericom Semiconductor Corporation – PT7A6632 32-Channel HDLC Controller

Data Sheet
PT7A6632 32-Channel HDLC Controller
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• PT7A6632 Receive Frame Synchronization Timing
Table 29. Receive Frame Synchronization Timing
Sym
Descr iption
Test Conditions
Min
Typ
Max Units
t_RS
RSYNC Setup Time
t_RH
RSYNC Hold Time
50
ns
50
ns
Figure 47. Diagram of Receive Frame Synchronization Timing (SIS=1)
RCLK
RSYNC
(From T1/E1 Controller)
RSER
(From PT7A6632)
t t _RS
RH
F BIT
BIT 1, CH1
a. Receive Serial Output - T1 Mode
RCLK
RSYNC
(From T1/E1 Controller)
RSER
(From PT7A6632)
t t _RS
RH
BIT 1, TS0
BIT 2, TS0
b. Receive Serial Output - CEPT PCM-30 Mode
PT019(05/02)
53
Ver:2