MC68HC705P9 Datasheet, PDF (145/156 Pages) Motorola, Inc – HCMOS Microcontroller Unit

Index
A
accumulator (A) . . . . . . . . . . . . . . . . . .40, 43
ADC . . . . . . . . . . . . . . . . . . . . . . . . . .79, 121
ADC (analog-to-digital converter)
block diagram . . . . . . . . . . . . . . . . . . .122
features . . . . . . . . . . . . . . . . . . . . . . . .121
I/O register summary . . . . . . . . . . . . .123
I/O registers . . . . . . . . . . . . . . . . . . . .126
low-power modes . . . . . . . . . . . . . . . .130
ADC data register
(ADDR) . . . . . . . . .124, 126–127, 129
ADC status and control register
(ADSCR) . . . . . . . . . . . . . . . .124, 126
addressing modes . . . . . . . . . . . . . . . . . . .40
ADON bit . . . . . . . . . . . . . . . . . . . . .127, 130
ADRC bit . . . . . . . . . . . . . . . . .124, 127, 130
alternate timer registers (ATRH/L) . . . . . .103
ALU . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .34
AN[3:0] bits . . . . . . . . . . . . . . . . . . . . . . . . .79
analog-to-digital converter . . . . . . . . . . . .121
arithmetic/logic unit (ALU) . . . . . . . . . . . . .36
B
bootloader ROM . . . . . . . . . . . . . . . . . . . . .26
bootload procedure . . . . . . . . . . . . . . . .29
bootloader circuit . . . . . . . . . . . . . . . . . .28
location . . . . . . . . . . . . . . . . . . . . . . . . .27
brownout . . . . . . . . . . . . . . . . . . . . . . . .58, 86
bypass capacitors . . . . . . . . . . . . . . . . . . . .15
C
C bit . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .46
case outlines . . . . . . . . . . . . . . .12, 143–144
CCF bit . . . . . . . . . . . . . . . . . . . . . . .124, 126
central processor unit . . . . . . . . . . . . . . . . .33
ceramic resonator circuit . . . . . . . . . . . . . .16
CH[2:0] bits . . . . . . . . . . . . . . . . . . . . . . .128
computer operating properly
watchdog . . . . . . . . . . . . . . . . . . . . .85
condition code register
(CCR) . . .36, 46, 59, 61–62, 102–105
COP . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .85
COP register (COPR) . . . . . . . . . . . . .58, 87
COP watchdog
COP in stop mode . . . . . . . . . . . . . . . .88
COP in wait mode . . . . . . . . . . . . . . . . .88
COP register (COPR) . . . . . . . . . . . . . .87
enabling and disabling . . . . . . . . . . . . .32
features . . . . . . . . . . . . . . . . . . . . . . . . .85
operation . . . . . . . . . . . . . . . . . . . . . . . .86
timeout period . . . . . . . . . . . . . . . . . . . .86
COP watchdog reset . . . . . . . . . . .58, 86–87
COPC bit . . . . . . . . . . . . . . . . . . . .58, 87–88
COPE bit . . . . . . . . . . . . . . . . . . . . . . . . . .32
CPU . . . . . . . . . . . . . . . . . . . . . . . . . . .33–34
block diagram . . . . . . . . . . . . . . . . . . . .35
control unit . . . . . . . . . . . . . . . . . . .34, 36
features . . . . . . . . . . . . . . . . . . . . . . . . .34
instruction set summary . . . . . . . . . . . .48
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