MC68HC908JK1 Datasheet, PDF (16/210 Pages) Motorola, Inc – MC68HC908JK1

List of Figures
Technical Data
16
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Title
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Interrupt Recognition Example . . . . . . . . . . . . . . . . . . . . . . . . . 84
Interrupt Status Register 1 (INT1). . . . . . . . . . . . . . . . . . . . . . . 86
Interrupt Status Register 2 (INT2). . . . . . . . . . . . . . . . . . . . . . . 86
Interrupt Status Register 3 (INT3). . . . . . . . . . . . . . . . . . . . . . . 87
Wait Mode Entry Timing . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 89
Wait Recovery from Interrupt or Break . . . . . . . . . . . . . . . . . . . 89
Wait Recovery from Internal Reset. . . . . . . . . . . . . . . . . . . . . . 89
Stop Mode Entry Timing . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 90
Stop Mode Recovery from Interrupt or Break . . . . . . . . . . . . . . 91
Break Status Register (BSR) . . . . . . . . . . . . . . . . . . . . . . . . . . 91
Reset Status Register (RSR) . . . . . . . . . . . . . . . . . . . . . . . . . . 93
Break Flag Control Register (BFCR) . . . . . . . . . . . . . . . . . . . . 94
8-1 X-tal Oscillator External Connections . . . . . . . . . . . . . . . . . . . . 96
8-2 RC Oscillator External Connections . . . . . . . . . . . . . . . . . . . . . 97
9-1 Monitor Mode Circuit. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 103
9-2 Low-Voltage Monitor Mode Entry Flowchart. . . . . . . . . . . . . . 106
9-3 Monitor Data Format. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 108
9-4 Sample Monitor Waveforms . . . . . . . . . . . . . . . . . . . . . . . . . . 108
9-5 Read Transaction . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 108
9-6 Break Transaction. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 109
9-7 Monitor Mode Entry Timing. . . . . . . . . . . . . . . . . . . . . . . . . . . 113
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10-9
TIM Block Diagram . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 117
TIM I/O Register Summary . . . . . . . . . . . . . . . . . . . . . . . . . . . 118
PWM Period and Pulse Width . . . . . . . . . . . . . . . . . . . . . . . . 122
TIM Status and Control Register (TSC) . . . . . . . . . . . . . . . . . 127
TIM Counter Registers (TCNTH:TCNTL) . . . . . . . . . . . . . . . . 130
TIM Counter Modulo Registers (TMODH:TMODL). . . . . . . . . 131
TIM Channel Status and Control Registers (TSC0:TSC1) . . . 132
CHxMAX Latency . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 135
TIM Channel Registers (TCH0H/L:TCH1H/L). . . . . . . . . . . . . 136
11-1 ADC I/O Register Summary . . . . . . . . . . . . . . . . . . . . . . . . . . 138
11-2 ADC Block Diagram . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 139
11-3 ADC Status and Control Register (ADSCR) . . . . . . . . . . . . . . 142
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MC68H(R)C908JL3 — Rev. 1.0
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