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MC68HC05X4 Datasheet, PDF (150/156 Pages) Motorola, Inc – HCMOS Microcontroller Unit | |||
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Index
Freescale Semiconductor, Inc.
N
N-bit in CCR . . . . . . . . . . . . . . . . . . . . . . . .33
negative flag . . . . . . . . . . . . . . . . . . . . . . . .33
non-volatile memory (NVM). . . . . . . . . . . . .60
normal mode 1 . . . . . . . . . . . . . . . . . . . . . .95
normal mode 2 . . . . . . . . . . . . . . . . . . . . . .95
O
OCF-bit in TSR . . . . . . . . . . . . . . . . . . . . .118
OCH/OCL â output compare registers. . .121
OCIE-bit in TCR . . . . . . . . . . . . . . . . . . . .117
OCM1, OCM0 bits in COCNTRL. . . . . . . . .94
OIE bit in CCNTRL . . . . . . . . . . . . . . . . . . .79
OIF bit in CINT . . . . . . . . . . . . . . . . . . . . . .87
OLVL-bit in TCR . . . . . . . . . . . . . . . . . . . .117
opcode map. . . . . . . . . . . . . . . . . . . . . . . . .48
operating modes . . . . . . . . . . . . . . . . . . . . .14
data retention mode . . . . . . . . . . . . . . . .56
entry conditions . . . . . . . . . . . . . . . . . . .14
low power modes . . . . . . . . . . . . . . . . . .55
single chip . . . . . . . . . . . . . . . . . . . . . . .14
STOP . . . . . . . . . . . . . . . . . . . . . . . . . . .55
WAIT . . . . . . . . . . . . . . . . . . . . . . . . . . .55
order numbers . . . . . . . . . . . . . . . . . . . . . .135
ordering information . . . . . . . . . . . . . . . . .134
literature distribution centers . . . . . . . .155
Mfax . . . . . . . . . . . . . . . . . . . . . . . . . . .156
Web server. . . . . . . . . . . . . . . . . . . . . .156
Web site . . . . . . . . . . . . . . . . . . . . . . . .156
OSC1/OSC2 . . . . . . . . . . . . . . . . . . . . . . . .25
oscillator connections . . . . . . . . . . . . . . . . .26
output compare . . . . . . . . . . . . . . . . . . . . .121
P
PA0âPA7. . . . . . . . . . . . . . . . . . . . . . . . . . .27
PADDR â port A data direction register . . .69
PADR â port A data register . . . . . . . . . . .68
PB0âPB7. . . . . . . . . . . . . . . . . . . . . . . . . . .27
PBDDR â port B data direction register . . .69
PBDR â port B data register . . . . . . . . . . .68
PCR â port configuration register . . . . . . .68
AWPS â port A WOI and pull-down select
. . . . . . . . . . . . . . . . . . . . . . . . . .69
BPDE â port B pull-down enable . . . . . . 69
BWE â port B WOI enable. . . . . . . . . . . 69
SLEEP â MCAN asleep flag . . . . . . . . . 68
TIMEN â timer enable . . . . . . . . . . 68, 112
WOIF â wired-OR interrupt flag . . . . . . . 68
pinout . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 24
pins
MDS/TCAP (VPP) . . . . . . . . . . . . . . . . . 25
OSC1/OSC2 . . . . . . . . . . . . . . . . . . . . . 25
PA0âPA7/PB0âPB7 . . . . . . . . . . . . . . . 27
RESET. . . . . . . . . . . . . . . . . . . . . . . . . . 27
RX0/RX1 . . . . . . . . . . . . . . . . . . . . . . . . 27
TX0/TX1 . . . . . . . . . . . . . . . . . . . . . . . . 27
VDDH . . . . . . . . . . . . . . . . . . . . . . . . . . 27
VSS and VDD . . . . . . . . . . . . . . . . . . . . 24
VSS1 . . . . . . . . . . . . . . . . . . . . . . . . . . . 27
POR . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 50
port A . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 66
port B . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 67
power considerations . . . . . . . . . . . . . . . . 128
power-on reset . . . . . . . . . . . . . . . . . . . . . . 50
program counter . . . . . . . . . . . . . . . . . . . . . 32
programmable timer
block diagram . . . . . . . . . . . . . . . . . . .113
during STOP mode . . . . . . . . . . . . . . . 122
during WAIT mode. . . . . . . . . . . . . . . . 122
free-running counter . . . . . . . . . . . . . . 115
ICH/ICL â input capture registers. . . . 119
input capture . . . . . . . . . . . . . . . . . . . . 119
interrupts . . . . . . . . . . . . . . . . . . . . . . . . 54
OCH/OCL â output compare registers
. . . . . . . . . . . . . . . . . . . . . . . . . 121
output compare . . . . . . . . . . . . . . . . . . 121
overflow . . . . . . . . . . . . . . . . . . . . . . . . 115
state diagrams . . . . . . . . . . . . . . .123, 125
TCH/TCL â counter registers . . . . . . . 114
TCR â timer control register. . . . . . . . 116
TSR â timer status register . . . . . . . . 118
programming model . . . . . . . . . . . . . . . . . . 30
R
RAM . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 59
RBF â receive buffer . . . . . . . . . . . . . . . . . 76
MC68HC05X4 Rev 1.0
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