M378T3354BG3-CD5 Datasheet, PDF(9/22 Page) Samsung semiconductor – 240pin Unbuffered Module based on 512Mb B-die 64/72-bit Non-ECC/ECC

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M378T3354BG3-CD5 Datasheet, PDF (9/22 Pages) Samsung semiconductor – 240pin Unbuffered Module based on 512Mb B-die 64/72-bit Non-ECC/ECC

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256MB, 512MB, 1GB Unbuffered DIMMs

DDR2 SDRAM

Functional Block Diagram: 1GB, 128Mx72 ECC Module(Populated as 2 ranks of x8 DDR2 SDRAMs)

M391T2953BG(Z)3 / M391T2953BG(Z)0

DQS0

DM0

DQS4

DM4

DQS1

DM1

DQ0

DQ1

DQ2

DQ3

DQ4

DQ5

DQ6

DQ7

I/O 0

I/O 1

I/O 2

I/O 3

I/O 4

I/O 5

I/O 6

I/O 7

CS DQS DQS

I/O 0

I/O 1

I/O 2

I/O 3

I/O 4

I/O 5

I/O 6

I/O 7

CS DQS DQS

DQS5

DM5

DQ32

DQ33

DQ34

DQ35

DQ36

DQ37

DQ38

DQ39

I/O 0

I/O 1

I/O 2

I/O 3

I/O 4

I/O 5

I/O 6

I/O 7

CS DQS DQS

I/O 0

I/O 1

I/O 2

I/O 3

I/O 4

I/O 5

I/O 6

I/O 7

CS DQS DQS

D13

DQS2

DM2

DQ8

DQ9

DQ10

DQ11

DQ12

DQ13

DQ14

DQ15

I/O 0

I/O 1

I/O 2

I/O 3

I/O 4

I/O 5

I/O 6

I/O 7

CS DQS DQS

I/O 0

I/O 1

I/O 2

I/O 3

I/O 4

I/O 5

I/O 6

I/O 7

CS DQS DQS

D10

DQS6

DM6

DQ40

DQ41

DQ42

DQ43

DQ44

DQ45

DQ46

DQ47

I/O 0

I/O 1

I/O 2

I/O 3

I/O 4

I/O 5

I/O 6

I/O 7

CS DQS DQS

I/O 0

I/O 1

I/O 2

I/O 3

I/O 4

I/O 5

I/O 6

I/O 7

CS DQS DQS

D14

DQS3

DM3

DQ16

DQ17

DQ18

DQ19

DQ20

DQ21

DQ22

DQ23

I/O 0

I/O 1

I/O 2

I/O 3

I/O 4

I/O 5

I/O 6

I/O 7

CS DQS DQS

I/O 0

I/O 1

I/O 2

I/O 3

I/O 4

I/O 5

I/O 6

I/O 7

CS DQS DQS

D11

DQS7

DM7

DQ48

DQ49

DQ50

DQ51

DQ52

DQ53

DQ54

DQ55

I/O 0

I/O 1

I/O 2

I/O 3

I/O 4

I/O 5

I/O 6

I/O 7

CS DQS DQS

I/O 0

I/O 1

I/O 2

I/O 3

I/O 4

I/O 5

I/O 6

I/O 7

CS DQS DQS

D15

DQS8

DM8

DQ24

DQ25

DQ26

DQ27

DQ28

DQ29

DQ30

DQ31

CB0

CB1

CB2

CB3

CB4

CB5

CB6

CB7

BA0 - BA1

A0 - A13

CKE0

CKE1

RAS

CAS

ODT0

ODT1

I/O 0

I/O 1

I/O 2

I/O 3

I/O 4

I/O 5

I/O 6

I/O 7

CS DQS DQS

I/O 0

I/O 1

I/O 2

I/O 3

I/O 4

I/O 5

I/O 6

I/O 7

CS DQS DQS

D12

DQ56

DQ57

DQ58

DQ59

DQ60

DQ61

DQ62

DQ63

I/O 0

I/O 1

I/O 2

I/O 3

I/O 4

I/O 5

I/O 6

I/O 7

CS DQS DQS

I/O 0

I/O 1

I/O 2

I/O 3

I/O 4

I/O 5

I/O 6

I/O 7

CS DQS DQS

D16

Serial PD

I/O 0

I/O 1

I/O 2

I/O 3

I/O 4

I/O 5

I/O 6

I/O 7

CS DQS DQS

I/O 0

I/O 1

I/O 2

I/O 3

I/O 4

I/O 5

I/O 6

I/O 7

CS DQS DQS

D17

SCL

A0 A1 A2

SA0 SA1 SA2

SDA

* Clock Wiring

Clock Input DDR2 SDRAMs

BA0-BA1 : DDR2 SDRAMs D0 - D17

A0-A13 : DDR2 SDRAMs D0 - D17

CKE : DDR2 SDRAMs D0 - D8

CKE : DDR2 SDRAMs D9 - D17

RAS : DDR2 SDRAMs D0 - D17

CAS : DDR2 SDRAMs D0 - D17

WE : DDR2 SDRAMs D0 - D17

ODT : DDR2 SDRAMs D0 - D8

VDDSPD

VDD/VDDQ

VREF

VSS

Serial PD

D0 - D17

*CK0/CK0 6 DDR2 SDRAMs

*CK1/CK1 6 DDR2 SDRAMs

*CK2/CK2 6 DDR2 SDRAMs

*Wire per Clock Loading

Table/Wiring Diagrams

Notes :

1. DQ,DM, DQS/DQS resistors : 22 Ohms Â± 5%.

2. BAx, Ax, RAS, CAS, WE resistors : 3 Ohms Â± 5%.

ODT : DDR2 SDRAMs D9 - D17

Rev. 1.5 Aug. 2005

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