M368L6523CUS Datasheet, PDF(9/25 Page) Samsung semiconductor

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M368L6523CUS Datasheet, PDF (9/25 Pages) Samsung semiconductor – DDR SDRAM Unbuffered Module

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256MB, 512MB, 1GB Unbuffered DIMM

DDR SDRAM

1GB, 128M x 72 ECC Module (M381L2923CUM) (Populated as 2 bank of x8 DDR SDRAM Module)

Functional Block Diagram

CS1

CS0

DQS0

DM0

DQ0

DQ1

DQ2

DQ3

DQ4

DQ5

DQ6

DQ7

DM/

I/O 7

I/O 6

I/O 1

I/O 0

I/O 5

I/O 4

I/O 3

I/O 2

CS DQS

DM/

I/O 0

I/O 1

I/O 6

I/O 7

I/O 2

I/O 3

I/O 4

I/O 5

CS DQS

DQS4

DM4

DQ32

DQ33

DQ34

DQ35

DQ36

DQ37

DQ38

DQ39

DM/

I/O 7

I/O 6

I/O 1

I/O 0

I/O 5

I/O 4

I/O 3

I/O 2

CS DQS

DM/

I/O 0

I/O 1

I/O 6

I/O 7

I/O 2

I/O 3

I/O 4

I/O 5

CS DQS

D13

DQS1

DM1

DQ8

DQ9

DQ10

DQ11

DQ12

DQ13

DQ14

DQ15

DM/

I/O 7

I/O 6

I/O 1

I/O 0

I/O 5

I/O 4

I/O 3

I/O 2

CS DQS

DM/

I/O 0

I/O 1

I/O 6

I/O 7

I/O 2

I/O 3

I/O 4

I/O 5

CS DQS

D10

DQS5

DM5

DQ40

DQ41

DQ42

DQ43

DQ44

DQ45

DQ46

DQ47

DM/

I/O 7

I/O 6

I/O 1

I/O 0

I/O 5

I/O 4

I/O 3

I/O 2

CS DQS

DM/

I/O 0

I/O 1

I/O 6

I/O 7

I/O 2

I/O 3

I/O 4

I/O 5

CS DQS

D14

DQS2

DM2

DQ16

DQ17

DQ18

DQ19

DQ20

DQ21

DQ22

DQ23

DM/

I/O 7

I/O 6

I/O 1

I/O 0

I/O 5

I/O 4

I/O 3

I/O 2

CS DQS

DM/

I/O 0

I/O 1

I/O 6

I/O 7

I/O 2

I/O 3

I/O 4

I/O 5

CS DQS

D11

DQS6

DM6

DQ48

DQ49

DQ50

DQ51

DQ52

DQ53

DQ54

DQ55

DM/

I/O 7

I/O 6

I/O 1

I/O 0

I/O 5

I/O 4

I/O 3

I/O 2

CS DQS

DM/

I/O 0

I/O 1

I/O 6

I/O 7

I/O 2

I/O 3

I/O 4

I/O 5

CS DQS

D15

DQS3

DM3

DQ24

DQ25

DQ26

DQ27

DQ28

DQ29

DQ30

DQ31

DM/

I/O 7

I/O 6

I/O 1

I/O 0

I/O 5

I/O 4

I/O 3

I/O 2

CS DQS

DM/

I/O 0

I/O 1

I/O 6

I/O 7

I/O 2

I/O 3

I/O 4

I/O 5

CS DQS

D12

DQS7

DM7

DQ56

DQ57

DQ58

DQ59

DQ60

DQ61

DQ62

DQ63

DM/

I/O 7

I/O 6

I/O 1

I/O 0

I/O 5

I/O 4

I/O 3

I/O 2

CS DQS

DM/

I/O 0

I/O 1

I/O 6

I/O 7

I/O 2

I/O 3

I/O 4

I/O 5

CS DQS

D16

DQS8

DM8

BA0 - BA1

A0 - A12

RAS

CAS

CKE0/1

DM/

CS DQS

DM/

CS DQS

CB0

I/O 7

CB1

I/O 6 D8

CB2

I/O 1

CB3

I/O 0

CB4

I/O 5

CB5

I/O 4

CB6

I/O 3

CB7

I/O 2

Serial PD

SCL

A0 A1

I/O 0

I/O 1

I/O 6

I/O 7

I/O 2

I/O 3

I/O 4

I/O 5

D17

SDA

SA0 SA1 SA2

VDDSPD

VDD/VDDQ

VREF

VSS

BA0-BA1 : DDR SDRAMs D0 - D17

A0-A12 : DDR SDRAMs D0 - D17

RAS : DDR SDRAMs D0 - D17

CAS : DDR SDRAMs D0 - D17

CKE : DDR SDRAMs D0 - D17

WE : DDR SDRAMs D0 - D17

* Clock Wiring

Clock

Input

DDR SDRAMs

*CK0/CK0 6 DDR SDRAMs

*CK1/CK1 6 DDR SDRAMs

*CK2/CK2 6 DDR SDRAMs

*Clock Net Wiring

SPD

D0 - D17

D3/D0/D5

R=120â¦

CK0/1/2

Card

Edge

D12/D9/D14

D8/D1/D6

D17/D10/D15

D4/D2/D7

D13/D11/D16

Notes :

1. DQ-to-I/O wiring is shown as recommended

but may be changed.

2. DQ/DQS/DM/CKE/CS relationships must be

maintained as shown.

3. DQ, DQS, DM/DQS resistors: 22 Ohms + 5%.

4. BAx, Ax, RAS, CAS, WE resistors:3 Ohms +

Rev. 1.0 February. 2005

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