Z86L88 Datasheet, PDF (5/80 Pages) Zilog, Inc. – INFRARED REMOTE CONTROLLERS

Z86L88
Low-Voltage IR Microcontroller
v
List of Figures
Figure 1. Counter/Timers Diagram . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3
Figure 2. Functional Block Diagram . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4
Figure 3. 28-Pin DIP/SOIC Pin Assignment . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 5
Figure 4. Test Load Diagram . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 7
Figure 5. Timing Diagram . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 10
Figure 6. Port 0 Configuration . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 14
Figure 7. Port 2 Configuration . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 15
Figure 8. Port 3 Configuration . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 16
Figure 9. Port 3 Counter/Timer Output Configuration . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 18
Figure 10. Program Memory Map (16K ROM) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 19
Figure 11. Expanded Register File Architecture . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 21
Figure 12. Register Pointer Register . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 22
Figure 13. TC8 Control Register—(0D) OH: Read/Write Except Where Noted . . . . . . . . . . . . 22
Figure 14. T8 and T16 Common Control Functions—(0D) 1H: Read/Write . . . . . . . . . . . . . . . 23
Figure 15. T16 Control Register—(0D) 2H: Read/Write Except Where Noted . . . . . . . . . . . . 24
Figure 16. Stop-Mode Recovery Register—(0F) 0BH: D6–D0 = Write Only, D7 = Read Only 25
Figure 17. Stop-Mode Recovery Register 2—(0F) 0DH: D2–D4, D6 Write Only . . . . . . . . . . . 26
Figure 18. Watch-Dog Timer Register—(0F) 0FH: Write Only . . . . . . . . . . . . . . . . . . . . . . . . . 27
Figure 19. Port Configuration Register (PCON)—(0F) 0H: Write Only . . . . . . . . . . . . . . . . . . 27
Figure 20. Port 2 Mode Register—F6H: Write Only . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 28
Figure 21. Port 3 Mode Register—F7H: Write Only . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 28
Figure 22. Port 0 and 1 Mode Register (F8h: Write Only) . . . . . . . . . . . . . . . . . . . . . . . . . . . . 29
Figure 23. Interrupt Priority Register—F9H: Write Only . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 30
Figure 24. Interrupt Request Register—FAH: Read/Write . . . . . . . . . . . . . . . . . . . . . . . . . . . . 30
Figure 25. Interrupt Mask Register—FBH: Read/Write . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 31
Figure 26. Flag Register—FCH: Read/Write . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 31
Figure 27. Register Pointer—FDH: Read/Write . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 32
Figure 28. Stack Pointer High—FEH: Read/Write . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 32
Figure 29. Stack Pointer Low—FFH: Read/Write . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 32
Figure 30. Register Pointer . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 33
Figure 31. Glitch Filter Circuitry . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 44
Figure 32. 8-Bit Counter/Timer Circuits . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 44
Figure 33. Transmit Mode Flowchart . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 46
Figure 34. T8_OUT in Single-Pass Mode . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 47
19-4614; Rev 0; 4/09
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