DS_M368L3223DTL Datasheet, PDF(4/12 Page) Samsung semiconductor

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DS_M368L3223DTL Datasheet, PDF (4/12 Pages) Samsung semiconductor – 256MB DDR SDRAM MODULE

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M368L3223DTL

Functional Block Diagram

184pin Unbuffered DDR SDRAM MODULE

DQS0

DM0

DQS1

DM1

DQS2

DM2

DQS3

DM3

BA0 - BA1

A0 - A13

RAS

CAS

CKE0

VDDSPD

VDD/V DDQ

VREF

VSS

CS0

DQ0

DQ1

DQ2

DQ3

DQ4

DQ5

DQ6

DQ7

DQ8

DQ9

DQ10

DQ11

DQ12

DQ13

DQ14

DQ15

DQ16

DQ17

DQ18

DQ19

DQ20

DQ21

DQ22

DQ23

DQ24

DQ25

DQ26

DQ27

DQ28

DQ29

DQ30

DQ31

I/O 7

I/O 6

I/O 1

I/O 0

I/O 5

I/O 4

I/O 3

I/O 2

I/O 7

I/O 6

I/O 1

I/O 0

I/O 5

I/O 4

I/O 3

I/O 2

I/O 7

I/O 6

I/O 1

I/O 0

I/O 5

I/O 4

I/O 3

I/O 2

I/O 7

I/O 6

I/O 1

I/O 0

I/O 5

I/O 4

I/O 3

I/O 2

DQS4

DM4

CS DQS

DQS5

DM5

C S DQS

DQS6

DM6

CS DQS

DQS7

DM7

BA0-BA1: SDRAMs D0 - D7

A0-A13: SDRAMs D0 - D7

RAS : SDRAMs D0 - D7

CAS : SDRAMs D0 - D7

CKE: SDRAMs D0 - D7

WE: SDRAMs D0 - D7

SPD

D0 - D7

SCL

DQ32

DQ33

DQ34

DQ35

DQ36

DQ37

DQ38

DQ39

I/O 7

I/O 6

I/O 1

I/O 0

I/O 5

I/O 4

I/O 3

I/O 2

CS DQS

DQ40

DQ41

DQ42

DQ43

DQ44

DQ45

DQ46

DQ47

I/O 7

I/O 6

I/O 1

I/O 0

I/O 5

I/O 4

I/O 3

I/O 2

CS DQS

DQ48

DQ49

DQ50

DQ51

DQ52

DQ53

DQ54

DQ55

I/O 7

I/O 6

I/O 1

I/O 0

I/O 5

I/O 4

I/O 3

I/O 2

CS DQS

* Clock Wiring

Clock

Input

CK0/CK0

CK1/CK1

CK2/CK2

SDRAMs

2 SDRAMs

3 SDRAMs

DQ56

DQ57

DQ58

DQ59

DQ60

DQ61

DQ62

DQ63

I/O 7

I/O 6

I/O 1

I/O 0

I/O 5

I/O 4

I/O 3

I/O 2

CS DQS

Serial PD

A0 A1 A2

SDA

*Clock Net Wiring

Dram1

R=120â¦

Card

Edge

Cap

Dram3

*(Cap)

Cap

Dram5

SA0 SA1 SA2

Cap

*If two DRAMs are loaded,

Cap will replace DRAM3

Notes:

1. DQ-to-I/O wiring is shown as recom-

mended but may be changed.

2. DQ/DQS/DM/CKE/ CS relationships

must be maintained as shown.

3. DQ, DQS, DM/DQS resistors: 22 Ohms.

Rev. 0.2 May. 2002

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