HYMD264646C8-M Datasheet, PDF (3/16 Pages) Hynix Semiconductor – Unbuffered DDR SDRAM DIMM

FUNCTIONAL BLOCK DIAGRAM
HYMD264646C(L)8-M/K/H/L
DQS0
DM0
DQ0
DQ1
DQ2
DQ3
DQ4
DQ5
DQ6
DQ7
DQS1
DM1
DQ8
DQ9
DQ10
DQ11
DQ12
DQ13
DQ14
DQ15
DQS2
DM2
DQ16
DQ17
DQ18
DQ19
DQ20
DQ21
DQ22
DQ23
DQS3
DM3
DQ24
DQ25
DQ26
DQ27
DQ28
DQ29
DQ30
DQ31
.^/CS0
.^/CS1
DM
I/O 7
I/O 6
I/O 1
I/O 0
I/O 5
I/O 4
I/O 3
I/O 2
/CS DQS
D0
DM /CS DQS
I/O 0
I/O 1
I/O 6
D8
I/O 7
I/O 2
I/O 3
I/O 4
I/O 5
DM
I/O 7
I/O 6
I/O 1
I/O 0
I/O 5
I/O 4
I/O 3
I/O 2
/CS DQS
D1
DM /CS DQS
I/O 0
I/O 1
I/O 6
D9
I/O 7
I/O 2
I/O 3
I/O 4
I/O 5
DM
I/O 7
I/O 6
I/O 1
I/O 0
I/O 5
I/O 4
I/O 3
I/O 2
/CS DQS
D2
DM
I/O 0
I/O 1
I/O 6
I/O 7
I/O 2
I/O 3
I/O 4
I/O 5
/CS DQS
D10
DM
I/O 7
I/O 6
I/O 1
I/O 0
I/O 5
I/O 4
I/O 3
I/O 2
/CS DQS
D3
DM
I/O 0
I/O 1
I/O 6
I/O 7
I/O 2
I/O 3
I/O 4
I/O 5
/CS DQS
D11
DQS4
DM4
DQ32
DQ33
DQ34
DQ35
DQ36
DQ37
DQ38
DQ39
DQS5
DM5
DQ40
DQ41
DQ42
DQ43
DQ44
DQ45
DQ46
DQ47
DQS6
DM6
DQ48
DQ49
DQ50
DQ51
DQ52
DQ53
DQ54
DQ55
DQS7
DM7
DQ56
DQ57
DQ58
DQ59
DQ60
DQ61
DQ62
DQ63
..
DM
I/O 7
I/O 6
I/O 1
I/O 0
I/O 5
I/O 4
I/O 3
I/O 2
/CS DQS
D4
DM
I/O 0
I/O 1
I/O 6
I/O 7
I/O 2
I/O 3
I/O 4
I/O 5
/CS DQS
D12
DM
I/O 7
I/O 6
I/O 1
I/O 0
I/O 5
I/O 4
I/O 3
I/O 2
/CS DQS
D5
DM
I/O 0
I/O 1
I/O 6
I/O 7
I/O 2
I/O 3
I/O 4
I/O 5
/CS DQS
D13
DM
I/O 7
I/O 6
I/O 1
I/O 0
I/O 5
I/O 4
I/O 3
I/O 2
/CS DQS
D6
DM
I/O 0
I/O 1
I/O 6
I/O 7
I/O 2
I/O 3
I/O 4
I/O 5
/CS DQS
D14
DM
I/O 7
I/O 6
I/O 1
I/O 0
I/O 5
I/O 4
I/O 3
I/O 2
/CS DQS
D7
DM
I/O 0
I/O 1
I/O 6
I/O 7
I/O 2
I/O 3
I/O 4
I/O 5
/CS DQS
D15
Serial PD
SCL
WP
A0
A1
A2
SA0
SA1
SA2
SDA
*Clock Wiring
Clock Input
SDRAMs
*CK0,/CK0
*CK1,/CK1
*CK2,/CK2
4 SDRAMs
6 SDRAMs
6 SDRAMs
* Wire per clock loading table/wiring diagrams
VDDSPD
VREF
VSS
VDDID
...... _{. .. = =}
SPD
D0 - D15
D0 - D15
=
D0 - D15
Strap:see Note 4
BA0-BA1
A0 - A12
CKE1
/RAS
/CAS
CKE0
/WE
BA0-BA1 : SDRAMs D0 - D15
A0 - A12 : SDRAMs D0 - D15
CKE1 : SDRAMs D8 - D15
/RAS : SDRAMs D0 - D15
/CAS : SDRAMs D0 - D15
CKE : SDRAMs D0 - D7
/WE : SDRAMs D0 - D15
Rev. 0.1 / Mar. 2003
Notes:
1. DQ-to-I/O wiring is shown as recommended
but may be changed
2. DQ/DQS/DM/CKE/S relationships must be
maintained as shown
3. DQ, DQS, DM/DQS resistors : 22Ohms+/-5%
4. VDDID strap connections
(for memory device VDD, VDDQ) :
Strap out :(open) : VDD=VDDQ
Strap In (Vss) : VDD= VDDQ
3