AK8115 Datasheet, PDF (2/6 Pages) Asahi Kasei Microsystems – Single Clock Generator

ASAHIKASEI
1. 端子説明
１－１）端子配置図
1:VDD
2:VSS
3:CLKOUT
[AK8115]
6:CLKIN
5:FSEL
4:OE
１－２）端子機能説明
端子番号
端子名
(端子タイプ)
説明
1
VDD
(PWR)
電源端子.
2
VSS
(PWR)
接地端子.
3
CLKOUT クロック出力端子. FSEL端子の設定により27.0MHzか74.17582MHzの
(DO) いずれかを出力します. パワーダウン時は“L”となります.
4
OE
CLKOUT出力イネーブル端子. この端子が“L”の時PLLはパワーダウン
(DI)
されCLKOUTは出力されません. 100kΩで内部プルダウン.
5
FSEL
(DI)
クロック出力周波数設定端子. “L”の時74.17582MHz、“H”の時27.0MHz
を出力します. 100kΩで内部プルダウン.
6
CLKIN
（DI）
クロック入力端子（41.538MHz）.
クロックが入力されない場合、パワーダウン状態にして下さい.
無入力もしくは不安定なクロック入力の場合、出力が安定しません。
PWR：電源
DO ：デジタル出力
DI ：デジタル入力
MS0519-J-02
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2008/2